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MACHLV210-12中文資料萊迪思數(shù)據(jù)手冊(cè)PDF規(guī)格書

MACHLV210-12
廠商型號(hào)

MACHLV210-12

功能描述

High Density EE CMOS Programmable Logic

文件大小

221.37 Kbytes

頁面數(shù)量

29

生產(chǎn)廠商 Lattice Semiconductor
企業(yè)簡稱

Lattice萊迪思

中文名稱

萊迪思半導(dǎo)體公司官網(wǎng)

原廠標(biāo)識(shí)
數(shù)據(jù)手冊(cè)

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更新時(shí)間

2025-1-13 20:00:00

MACHLV210-12規(guī)格書詳情

GENERAL DESCRIPTION

The MACHLV210 is a member of the high performance EE CMOS MACH 2 device family. This device has approximately six times the logic macrocell capability of the popular PAL22V10 at an equal speed with a lower cost per macrocell. It is architecturally identical to the MACH210, with the addition of I/O pull-up/pull-down resistors and low-voltage, low-power operation.

DISTINCTIVE CHARACTERISTICS

■ Low-voltage operation, 3.3-V JEDEC compatible — VCC = +3.0 V to +3.6 V

■ < 5 mA standby current

■ Patented design allows minimal standby current without speed degradation

■ Exclusively designed for 3.3-V applications

■ 44 Pins

■ 64 Macrocells

■ 12 ns tPDCommercial 18 ns tPDIndustrial

■ 83.3 MHz fCNT

■ 38 Bus-Friendly Inputs

■ 32 Outputs

■ 64 Flip-flops; 2 clock choices

■ 4 “PAL22V16” blocks with buried macrocells

■ Pin-, function-, and JEDEC-compatible with MACH210

■ Pin-compatible with MACH110, MACH111, MACH210, MACH211, and MACH215

產(chǎn)品屬性

  • 型號(hào):

    MACHLV210-12

  • 制造商:

    LATTICE

  • 制造商全稱:

    Lattice Semiconductor

  • 功能描述:

    High Density EE CMOS Programmable Logic

供應(yīng)商 型號(hào) 品牌 批號(hào) 封裝 庫存 備注 價(jià)格
LATTICE(萊迪思)
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