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PDSP16116A中文資料ZARLINK數(shù)據(jù)手冊PDF規(guī)格書

PDSP16116A
廠商型號

PDSP16116A

功能描述

16 by 16 Bit Complex Multiplier

文件大小

149.08 Kbytes

頁面數(shù)量

18

生產(chǎn)廠商 Zarlink Semiconductor
企業(yè)簡稱

ZARLINK

中文名稱

Zarlink Semiconductor官網(wǎng)

原廠標識
數(shù)據(jù)手冊

下載地址一下載地址二到原廠下載

更新時間

2025-1-11 10:01:00

PDSP16116A規(guī)格書詳情

The PDSP16116A will multiply two complex (16 + 16) bit words every 50ns and can be configured to output the complete complex (32 + 32) bit result within a single cycle. The data format is fractional twos complement.

FEATURES

■ Complex Number (16 + 16) X (16 + 16) Multiplication

■ Full 32 bit Result

■ 20MHz Clock Rate

■ Block Floating Point FFT Butterfly Support

■ -1 times -1 Trap

■ Twos Complement Fractional Arithmetic

■ TTL Compatible I/O

■ Complex Conjugation

■ 2 Cycle Fall Through

■ 144 pin PGA or QFP packages

APPLICATION

■ Fast Fourier Transforms

■ Digital Filtering

■ Radar and Sonar Processing

■ Instrumentation

■ Image Processing

產(chǎn)品屬性

  • 型號:

    PDSP16116A

  • 制造商:

    ZARLINK

  • 制造商全稱:

    Zarlink Semiconductor Inc

  • 功能描述:

    16 by 16 Bit Complex Multiplier

供應(yīng)商 型號 品牌 批號 封裝 庫存 備注 價格
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